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龙图腾网获悉苏州异格技术有限公司申请的专利一种FPGA时钟布局布线方法及系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120493852B 。

龙图腾网通过国家知识产权局官网在2026-04-24发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510546746.0，技术领域涉及：G06F30/394；该发明授权一种FPGA时钟布局布线方法及系统是由请求不公布姓名;请求不公布姓名设计研发完成，并于2025-04-28向国家知识产权局提交的专利申请。

本一种FPGA时钟布局布线方法及系统在说明书摘要公布了：本发明涉及时钟布局布线技术领域，公开了一种FPGA时钟布局布线方法及系统，该方法应用于FPGA装置，该FPGA装置包含多个时钟域，该方法包括：缩小时钟域内时钟的边界框，直至各个时钟域内的时钟数目合法；对时钟的时钟资源进行分配，使得分配到同一时钟资源的时钟的边界框之间不重叠，而且时钟的时钟资源不超过对应的边界框范围；时钟资源分配完成后，在各个时钟的边界框内构建时钟平衡树，使得各个时钟从源头到各个目的节点的延时一样；通过路由算法实现从时钟源到时钟平衡树根节点的路由。对时钟资源进行提前分配并且构建时钟平衡树，确保在布局布线流程中不会出现资源的拥塞问题，且能够有效减少信号在传输过程中的衰减和干扰。

本发明授权一种FPGA时钟布局布线方法及系统在权利要求书中公布了：1.一种FPGA时钟布局布线方法，其特征在于，所述方法应用于FPGA装置，所述FPGA装置包含多个时钟域，所述方法包括： 缩小时钟域内时钟的边界框，直至各个时钟域内的时钟数目合法； 对时钟的时钟资源进行分配，使得分配到同一时钟资源的时钟的边界框之间不重叠，而且时钟的时钟资源不超过对应的边界框范围； 时钟资源分配完成后，在各个时钟的边界框内构建时钟平衡树，使得各个时钟从源头到各个目的节点的延时一样； 通过路由算法实现从时钟源到时钟平衡树根节点的路由； 其中，所述对时钟的时钟资源进行分配，包括： 获取各个时钟域内各个时钟间的距离和布局参数； 根据所述距离和布局参数，为各个时钟分配一个唯一的资源标识，使得分配到同一时钟资源的时钟的边界框之间不重叠，而且时钟的时钟资源不超过对应的边界框范围； 所述对时钟的时钟资源进行分配，还包括： 将每个时钟作为图中的一个节点，将两个时钟之间存在布局冲突的情况作为边的连接；如果两个时钟的边界框重叠，则这两个时钟之间存在冲突，分配不同的资源；为每个时钟节点分配一个颜色，不同颜色代表不同的资源，确保相邻的节点不共享相同的资源。

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