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龙图腾网获悉西安翔腾微电子科技有限公司申请的专利一种基于掩码的图形处理器像素Cache缺失请求合并系统及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115393162B 。

龙图腾网通过国家知识产权局官网在2026-04-21发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211001958.3，技术领域涉及：G06T1/20；该发明授权一种基于掩码的图形处理器像素Cache缺失请求合并系统及方法是由王维;田泽;郑新建;张淑;杜琴琴设计研发完成，并于2022-08-20向国家知识产权局提交的专利申请。

本一种基于掩码的图形处理器像素Cache缺失请求合并系统及方法在说明书摘要公布了：本发明涉及一种基于掩码的图形处理器像素Cache缺失请求合并系统及方法。本发明的系统包括缺失请求的待合并信息的检测和排序模块、读掩码缺失合并处理模块、读TAG缺失合并处理模块和写缺失合并处理模块，缺失请求的待合并信息的检测和排序模块分别与读掩码缺失合并处理模块、读TAG缺失合并处理模块、写缺失合并处理模块连接，缺失请求的待合并信息的检测和排序模块用于缺失请求的待合并信息的检测和排序，读掩码缺失合并处理模块用于读掩码缺失的合并处理，读TAG缺失合并处理模块用于读TAG缺失的合并处理，写缺失合并处理模块用于写缺失的合并处理。本发明能够减少缺失替换率，减少DDR带宽，并且在流水的情况下最快可达到一个时钟周期一个请求，很好的提高GPU绘制性能。

本发明授权一种基于掩码的图形处理器像素Cache缺失请求合并系统及方法在权利要求书中公布了：1.一种基于掩码的图形处理器像素Cache缺失请求合并方法，其特征在于：该方法包括以下步骤： 1缺失请求的待合并信息的检测和排序； 1.1排序之前需要将PCache的流水线上排空，并且不再接收新的请求，排序功能在一个时钟周期内完成； 1.2将32组MSHR中的缺失地址寄存器与当前更新处理的缺失地址进行相同Block的比较，产生一个32bits的读掩码缺失标记寄存器、一个32bits的读TAG缺失标记寄存器和一个写缺失标记寄存器； 1.3根据标记寄存器的标记，从对应MSHR缺失地址中取出xy坐标的偏移，按照从0~15进行排序，将排序产生的MSHR地址存储到寄存器中，方便后续按照顺序进行合并时从正确的MSHR中读数据以及对正确的MSHR标记位进行更新； 2读掩码缺失的合并处理； 2.1排序结束后，连续16个时钟周期从DDR中读出数据的缓存中读出16个数据； 2.2同时从TAG命中标记的数据RAM的Block中读出16个数据以及掩码； 2.3将读出的数据和掩码进行锁存并将锁存数据按照掩码进行合并，数据合并后将最新的数据写入Cache数据存储中； 2.4在连续16个时钟周期中根据读掩码缺失标记寄存器，在对应的16个标记中有为1的情况，将合并后的数据输出，对应输出读地址，并更新MSHR的标记位为低； 2.516个合并后的数据都写入Cache数据存储中，此时MSHR中所有与当前处理相同Block的读掩码缺失请求也全部返回数据，当前处理结束，更新对应的标记信息； 3读TAG缺失的合并处理； 4写缺失的合并处理。

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