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龙图腾网获悉上海壁仞科技股份有限公司申请的专利DDR输出驱动器电路和DDR芯片获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121257448B 。

龙图腾网通过国家知识产权局官网在2026-04-07发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511755609.4，技术领域涉及：G06F30/367；该发明授权DDR输出驱动器电路和DDR芯片是由请求不公布姓名;请求不公布姓名设计研发完成，并于2025-11-27向国家知识产权局提交的专利申请。

本DDR输出驱动器电路和DDR芯片在说明书摘要公布了：本公开涉及一种DDR输出驱动器电路和DDR芯片，该电路包括：第一延迟模块，用于接收待发送数据信号并进行延迟得到第一延迟信号；第二延迟模块，用于接收待发送数据信号并进行延迟得到第二延迟信号；第一输出驱动模块，耦接于第一延迟模块，用于接收第一延迟信号并对其进行驱动得到并输出第一延迟驱动信号；第二输出驱动模块，耦接于第二延迟模块，用于接收第二延迟信号并对其进行驱动得到并输出第二延迟驱动信号；第一输出驱动模块和第二输出驱动模块的输出端耦接，使得第一延迟驱动信号和第二延迟驱动信号耦合得到加重后的输出数据信号。本公开在实现阻抗匹配的基础上还实现了输出数据信号的加重处理，有利于对抗传输线的高频损耗。

本发明授权DDR输出驱动器电路和DDR芯片在权利要求书中公布了：1.一种DDR输出驱动器电路，其特征在于，包括： 第一延迟模块，用于接收待发送数据信号，对所述待发送数据信号进行第一延迟得到第一延迟信号； 第二延迟模块，用于接收所述待发送数据信号，对所述待发送数据信号进行第二延迟得到第二延迟信号； 第一输出驱动模块，耦接于所述第一延迟模块，用于接收所述第一延迟信号并对所述第一延迟信号进行驱动得到并输出第一延迟驱动信号； 第二输出驱动模块，耦接于所述第二延迟模块，用于接收所述第二延迟信号并对所述第二延迟信号进行驱动得到并输出第二延迟驱动信号； 其中，所述第一输出驱动模块和所述第二输出驱动模块的输出端耦接，使得所述第一延迟驱动信号和所述第二延迟驱动信号耦合得到加重后的输出数据信号； 其中，所述第一输出驱动模块包括第一数量个输出驱动器，所述第二输出驱动模块包括第二数量个输出驱动器，所述第一数量个输出驱动器和所述第二数量个输出驱动器组成由预设数量个输出驱动器所构成的输出驱动器阵列。

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